3.1 项目1 设计基本逻辑门电路
书名：
Verilog HDL与CPLD/FPGA项目开发教程（第3版）
作者名：
聂章龙 周凌翱主编
本章字数：
1109字
更新时间：
2023-10-27 18:43:00
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